EV12DS480數(shù)模轉換器Teledyne E2V
發(fā)布時間：2022-05-12 16:37:41 瀏覽：1948
EV12DS480數(shù)模轉換器提供高于7GHz的模擬帶寬，有利于實現(xiàn)高達K波段（26.5ghz）的多波段直接數(shù)字合成。
與EV12DS460相比較，EV12DS480數(shù)模轉換器提供了拓展的頻率性能，并受益于Teledynee2v對領先檢測技術的投資，這將DAC的最低保證性能范圍顯著拓展至8GSPS，并可形成高達26.5GHz的清晰信號。數(shù)據(jù)表的最低性能確保是在之前從未實現(xiàn)的頻率水平下提供的
EV12DS480數(shù)模轉換器也適合用在空間應用。它是為塑料包裝的新空間系統(tǒng)開發(fā)的，并提供各種安全可靠性級別，包括NASA1級。
EV12DS480數(shù)模轉換器的運轉速度高達8.5GSPS。有四種輸出使用模式（NRZ、RTZ、NRTZ和RF）。EV12DS480數(shù)模轉換器還包括一個獨有的可編程脈沖整形性能，可用作跨多個奈奎斯特區(qū)域作業(yè)。
關鍵特征
?12位分辨率
?6.4GSP確保轉化率（最高7GSP）
?8.0GSps確保轉換，減少數(shù)據(jù)速率（最高可運轉8.5GSps）
?–3dB模擬輸出帶寬7.5GHz（DAC輸出階躍響應的上升和下降時間為30ps）
?兼容高達12GHz（X波段）的射頻信號合成
?兼容高達24GHz的射頻信號合成（減少輸出功率）
?4:1或2:1集成并行多路復用器（可選）
?可選輸出模式：
歸零（RTZ）、不歸零（NRZ）、狹窄
歸零（NRTZ）和射頻（RF）
?低延遲時間：3個時鐘周期
?2.6瓦功能損耗（4:1多路復用）
?3線串行接口
?LVDS差分數(shù)據(jù)輸入和DSP時鐘輸出。
?性能：
–可選擇MUX比4:1（最高8.0GSps），2:1（最高3.2GSps）
–用戶友好的性能，通過3WSI串行接口進行數(shù)字控制：
?增益調節(jié)
?輸出時鐘分頻器選擇（調整DSP時鐘分頻器比的可能性）（OCDS）
?調節(jié)整形脈沖寬度（RPW）和整形脈沖開始（RPB）以優(yōu)化性能
?與DSP同步的時鐘相移選擇（PSS[2:0]）
?時鐘模式下輸入1/2/4（IUCM）
?直接訪問bitOCD和PSS
?與FPGA檢驗（IDC）的定時接口的輸入數(shù)據(jù)檢驗位
?FPGA的定時違規(guī)標志（設置或保持）
?通訊監(jiān)控（TVF）
?模擬輸出差動擺幅：1Vpp（100?差分阻抗）
?可用作多個DAC同步的外部同步
?電源：3.3伏（數(shù)字）、3.3伏和5伏（模擬）
?FpBGA封裝（15x15mm機身尺寸，1mm寬度）
?DOCSIS3.0兼容
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